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(P2025 - 1S) SISTEMAS DIGITALES A
Avance Proyecto segundo parcial

Apertura: viernes, 30 de mayo de 2025, 18:46
Cierre: lunes, 7 de julio de 2025, 03:46


Diseñar e implementar un Proyecto en vivado con tema a su elección que incluya el uso de FPGA y que interactúe con Mathlab, compatible con Vivado. El proyecto deberá incluir sensores externos y una IPcore desarrollada por otro usuario como Memorias, Divisores de reloj, Integradores, etc.


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