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(P2025 - 1S) SISTEMAS DIGITALES A
PrACTICA 3.
Informe de Laboratorio
sumador restador
Apertura:
martes, 18 de marzo de 2025, 07:49
Cierre:
jueves, 15 de mayo de 2025, 23:03
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Calendario Académico 2023-2S
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PRUEBA INTERMEDIA
Tema 1 - Nombre del Tema
Tema 2 - Nombre del Tema
Tema 3
Tema 4
Tema 6
Defensa Unidad 1 y 2. proyecto parcial
evaluacion ejercicio 1
Informe de Práctica 1
Informe de Práctica 2
Informe de Taller 1
Informe de Laboratorio
Lección Tema 1
Prueba Unidad 1
Documento de Consulta 1
Algebra de Boole
clase FPGA 1
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Tema 4 (copia)
practica 4. Informe de Laboratorio multiplexores
EJERCICIOS SIMPLIFICACION
evaluacion principal
Tema 1 - Nombre del Tema (copia) (copia)
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Maquina de estados
contadores
Descripcion de Hardware. P1. ALU -50%
Descripcion de Hardware. P3. COMPARADORES
Descripcion de Hardware. P3. COMPARADORES, ENTREGA TARDIA
Descripcion de Hardware. P3. CONTADOR
Maquinas de estado 2 VHDL
TALLER 1>Informe PERSONAL multiplexor 4_1
Actividad practica 1 ensamblado
ensamblado previo de sumadores
ensamblado previodecodificador 7 segmentos
Ensamblado sumador viernes 20
Actividad practica 3 Microondas
desarrollo de comparador y decodificador BCD a 7 segmentos
Flip Flops
decodificador, funciones
Memorias
Tema 1 - Nombre del Tema (copia) (copia) (copia)
Tema 2 - Nombre del Tema (copia) (copia) (copia)
Tema Proyecto segundo parcial
Avance Proyecto segundo parcial
EVALUACION VHDL 1
EVALUACION VHDL 2
EVALUACION DISEÑO COMBINACIONAL
EVALUACION DISEÑO SECUENCIAL
PROYECTO DE INVESTIGACION FORMATIVA
Principio de operacion de Flip Flops
Memorias
Actividades de Recuperación Pedagógica
Evaluación de Satisfacción del Curso
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